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2011 International Symposium on Electronic System Design - 最新文献
Optimizing Test Architecture for TSV Based 3D Stacked ICs Using Hard SOCs
Pub Date : 2011-12-19 DOI: 10.1109/ISED.2011.29 S. Roy, C. Giri, A. Chakraborty, Subhro Mukherjee, D. K. Das, H. RahamanRuntime Congestion and Crosstalk Aware Router for FPGA Using Jbits3.0 for Partial Reconfigurable Application
Pub Date : 2011-12-19 DOI: 10.1109/ISED.2011.16 N. Das, P. Roy, H. RahamanAn Efficient Method for Using Transaction Level Assertions in a Class Based Verification Environment
Pub Date : 2011-12-19 DOI: 10.1109/ISED.2011.32 Naveen Sudhish, B. Raghavendra, Harish Yagain
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