Proceedings of Meeting on Verilog HDL (IVC/VIUF'97)

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Proceedings of Meeting on Verilog HDL (IVC/VIUF'97) - 最新文献

High-level architectural simulation of the Torus Routing Chip

Pub Date : 1997-03-31 DOI: 10.1109/IVC.1997.588531 L. Natvig

OMI-a standard model interface for IP delivery

Pub Date : 1997-03-31 DOI: 10.1109/IVC.1997.588538 D. Dunlop, K. McKinley

Synthesis support for design partitioning

Pub Date : 1997-03-31 DOI: 10.1109/IVC.1997.588529 J. Willoughby
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