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2016 IEEE Asian Solid-State Circuits Conference (A-SSCC) - 最新文献
Fractional-N DPLL based low power clocking architecture for 1–14 Gb/s multi-standard transmitter
Pub Date : 2017-07-06 DOI: 10.1109/JSSC.2017.2715160 Masum Hossain, W. El-Halwagy, A. D. Hossain, AurangozebA 16–43 GHz low-noise amplifer with 2.5–4.0 dB noise figure
Pub Date : 2016-11-09 DOI: 10.1109/ASSCC.2016.7844207 Zhe Chen, Hao Gao, D. Leenaerts, D. Milosevic, P. Baltus
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