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European Design Automation Conference - 最新文献
Protocol merging: a VHDL-based method for clock cycle minimizing and protocol preserving scheduling of IO-operations
Pub Date : 1994-09-23 DOI: 10.5555/198174.198342 W. Ecker, M. Glesner, Andreas VombachA process algebra interpretation of a verification oriented overlanguage of VHDL
Pub Date : 1994-09-23 DOI: 10.1145/198174.198314 C. Bayol, B. Soulas, D. Borrione, Fulvio Corno, P. PrinettoFormal verification of behavioral VHDL specifications: a case study
Pub Date : 1994-09-23 DOI: 10.5555/198174.198328 F. Nicoli, L. Pierre
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