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Sixteenth International Symposium on Quality Electronic Design - 最新文献
A logic difference generator with spare cells consideration for ECO synthesis
Pub Date : 2015-04-16 DOI: 10.1109/ISQED.2015.7085491 Jui-Hung Hung, Yu-Cheng Lin, W. Cheng, T. HsiehResource allocation methodology for through silicon vias and sleep transistors in 3D ICs
Pub Date : 2015-04-16 DOI: 10.1109/ISQED.2015.7085481 Hailang Wang, E. SalmanLow power scheduling in high-level synthesis using dual-Vth library
Pub Date : 2015-03-02 DOI: 10.1109/ISQED.2015.7085477 S. Ghandali, B. Alizadeh, Z. Navabi
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